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You searched for +publisher:"Universidade do Rio Grande do Sul" +contributor:("Susin, Altamiro Amadeu"). Showing records 1 – 30 of 49 total matches.

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1. Diniz, Claudio Machado. Arquitetura de hardware dedicada para a predição intra-quadro em codificadores do padrão H.264/AVC de compressão de vídeo.

Degree: 2009, Universidade do Rio Grande do Sul

A compressão de vídeo é essencial para aplicações de vídeo digital. Devido ao elevado volume de informações contidas em um vídeo digital, um processo de… (more)

Subjects/Keywords: Video coding; Microeletrônica; Compressao : Video; H.264/AVC; Intra-frame prediction; Digital hardware design; High definition video

…2. H.264/AVC 3. Predição IntraQuadro 4. Hardware. I. Susin, Altamiro Amadeu. II. Título… 

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APA (6th Edition):

Diniz, C. M. (2009). Arquitetura de hardware dedicada para a predição intra-quadro em codificadores do padrão H.264/AVC de compressão de vídeo. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/17801

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Chicago Manual of Style (16th Edition):

Diniz, Claudio Machado. “Arquitetura de hardware dedicada para a predição intra-quadro em codificadores do padrão H.264/AVC de compressão de vídeo.” 2009. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/17801.

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MLA Handbook (7th Edition):

Diniz, Claudio Machado. “Arquitetura de hardware dedicada para a predição intra-quadro em codificadores do padrão H.264/AVC de compressão de vídeo.” 2009. Web. 17 Jan 2021.

Vancouver:

Diniz CM. Arquitetura de hardware dedicada para a predição intra-quadro em codificadores do padrão H.264/AVC de compressão de vídeo. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2009. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/17801.

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Council of Science Editors:

Diniz CM. Arquitetura de hardware dedicada para a predição intra-quadro em codificadores do padrão H.264/AVC de compressão de vídeo. [Thesis]. Universidade do Rio Grande do Sul; 2009. Available from: http://hdl.handle.net/10183/17801

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Universidade do Rio Grande do Sul

2. Porto, Marcelo. Arquiteturas de alto desempenho e baixo custo em hardware para a estimação de movimento em vídeos digitais.

Degree: 2008, Universidade do Rio Grande do Sul

A evolução das Tecnologias de Informação e Comunicação (TIC) favoreceu o crescimento do uso de variados meios na comunicação. Entre diversos meios, o vídeo em… (more)

Subjects/Keywords: Microeletrônica; Video compression; Motion estimation; Compressao : Video; VLSI design

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APA (6th Edition):

Porto, M. (2008). Arquiteturas de alto desempenho e baixo custo em hardware para a estimação de movimento em vídeos digitais. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/13117

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Chicago Manual of Style (16th Edition):

Porto, Marcelo. “Arquiteturas de alto desempenho e baixo custo em hardware para a estimação de movimento em vídeos digitais.” 2008. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/13117.

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MLA Handbook (7th Edition):

Porto, Marcelo. “Arquiteturas de alto desempenho e baixo custo em hardware para a estimação de movimento em vídeos digitais.” 2008. Web. 17 Jan 2021.

Vancouver:

Porto M. Arquiteturas de alto desempenho e baixo custo em hardware para a estimação de movimento em vídeos digitais. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2008. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/13117.

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Council of Science Editors:

Porto M. Arquiteturas de alto desempenho e baixo custo em hardware para a estimação de movimento em vídeos digitais. [Thesis]. Universidade do Rio Grande do Sul; 2008. Available from: http://hdl.handle.net/10183/13117

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Universidade do Rio Grande do Sul

3. Bonatto, Alexsandro Cristóvão. Núcleos de interface de memória DDR SDRAM para sistemas-em-chip.

Degree: 2009, Universidade do Rio Grande do Sul

Dispositivos integrados de sistemas-em-chip (SoC), especialmente aqueles dedicados às aplicações multimídia, processam grandes quantidades de dados armazenados em memórias. O desempenho das portas de memória… (more)

Subjects/Keywords: Fpga; Memory controller; Double data rate SDRAM; Microeletrônica; Sistemas digitais; Firm-IPs; Memória; System-on-a-chip; FPGA; Memory test

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APA (6th Edition):

Bonatto, A. C. (2009). Núcleos de interface de memória DDR SDRAM para sistemas-em-chip. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/17291

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Chicago Manual of Style (16th Edition):

Bonatto, Alexsandro Cristóvão. “Núcleos de interface de memória DDR SDRAM para sistemas-em-chip.” 2009. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/17291.

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MLA Handbook (7th Edition):

Bonatto, Alexsandro Cristóvão. “Núcleos de interface de memória DDR SDRAM para sistemas-em-chip.” 2009. Web. 17 Jan 2021.

Vancouver:

Bonatto AC. Núcleos de interface de memória DDR SDRAM para sistemas-em-chip. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2009. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/17291.

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Council of Science Editors:

Bonatto AC. Núcleos de interface de memória DDR SDRAM para sistemas-em-chip. [Thesis]. Universidade do Rio Grande do Sul; 2009. Available from: http://hdl.handle.net/10183/17291

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Universidade do Rio Grande do Sul

4. Matos, Débora da Silva Motta. Interfaces parametrizáveis para aplicações interconectadas por uma rede-em-chip.

Degree: 2010, Universidade do Rio Grande do Sul

As redes-em-chip (NoCs) surgiram como uma alternativa aos atuais problemas de interconexão decorrentes da redução da escala de tecnologia de fabricação de circuitos integrados. O… (more)

Subjects/Keywords: Network interfaces; Microeletrônica; Network-on-chip; Testes : Sistemas digitais; H.264 video decoder; Interconnection solutions; Processing elements; System-on-chip

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APA (6th Edition):

Matos, D. d. S. M. (2010). Interfaces parametrizáveis para aplicações interconectadas por uma rede-em-chip. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/27659

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Chicago Manual of Style (16th Edition):

Matos, Débora da Silva Motta. “Interfaces parametrizáveis para aplicações interconectadas por uma rede-em-chip.” 2010. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/27659.

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MLA Handbook (7th Edition):

Matos, Débora da Silva Motta. “Interfaces parametrizáveis para aplicações interconectadas por uma rede-em-chip.” 2010. Web. 17 Jan 2021.

Vancouver:

Matos DdSM. Interfaces parametrizáveis para aplicações interconectadas por uma rede-em-chip. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2010. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/27659.

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Council of Science Editors:

Matos DdSM. Interfaces parametrizáveis para aplicações interconectadas por uma rede-em-chip. [Thesis]. Universidade do Rio Grande do Sul; 2010. Available from: http://hdl.handle.net/10183/27659

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Universidade do Rio Grande do Sul

5. Renner, Adriano. Arquitetura de um decodificador de áudio para o Sistema Brasileiro de Televisão Digital e sua implementação em FPGA.

Degree: 2011, Universidade do Rio Grande do Sul

O Sistema Brasileiro de Televisão Digital estabeleceu como padrão de codificação de áudio o algoritmo MPEG-4 Advanced Audio Coding, mais precisamente nos perfis Low Complexity,… (more)

Subjects/Keywords: MPEG-4 AAC; Microeletrônica; Áudio digital; SBTVD; Digital audio; Fpga; AAC LC; Audio decoding; FPGA

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APA (6th Edition):

Renner, A. (2011). Arquitetura de um decodificador de áudio para o Sistema Brasileiro de Televisão Digital e sua implementação em FPGA. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/49363

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Chicago Manual of Style (16th Edition):

Renner, Adriano. “Arquitetura de um decodificador de áudio para o Sistema Brasileiro de Televisão Digital e sua implementação em FPGA.” 2011. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/49363.

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MLA Handbook (7th Edition):

Renner, Adriano. “Arquitetura de um decodificador de áudio para o Sistema Brasileiro de Televisão Digital e sua implementação em FPGA.” 2011. Web. 17 Jan 2021.

Vancouver:

Renner A. Arquitetura de um decodificador de áudio para o Sistema Brasileiro de Televisão Digital e sua implementação em FPGA. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2011. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/49363.

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Council of Science Editors:

Renner A. Arquitetura de um decodificador de áudio para o Sistema Brasileiro de Televisão Digital e sua implementação em FPGA. [Thesis]. Universidade do Rio Grande do Sul; 2011. Available from: http://hdl.handle.net/10183/49363

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Universidade do Rio Grande do Sul

6. Reinbrecht, Cezar Rodolfo Wedig. Desenvolvimento e avaliação de redes-em-chip hierárquicas e reconfiguráveis para MPSoCs.

Degree: 2012, Universidade do Rio Grande do Sul

Com o advento dos processos submicrônicos, a capacidade de integração de transistores numa mesma pastilha de silício atingiu níveis que possibilitaram a construção dos sistemas… (more)

Subjects/Keywords: Microeletrônica; MPSoCs; Network-on-chip; Sistemas embarcados; MPSoC; Interconnections; Adaptive architecture; System-on-chip

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APA (6th Edition):

Reinbrecht, C. R. W. (2012). Desenvolvimento e avaliação de redes-em-chip hierárquicas e reconfiguráveis para MPSoCs. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/67148

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Chicago Manual of Style (16th Edition):

Reinbrecht, Cezar Rodolfo Wedig. “Desenvolvimento e avaliação de redes-em-chip hierárquicas e reconfiguráveis para MPSoCs.” 2012. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/67148.

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MLA Handbook (7th Edition):

Reinbrecht, Cezar Rodolfo Wedig. “Desenvolvimento e avaliação de redes-em-chip hierárquicas e reconfiguráveis para MPSoCs.” 2012. Web. 17 Jan 2021.

Vancouver:

Reinbrecht CRW. Desenvolvimento e avaliação de redes-em-chip hierárquicas e reconfiguráveis para MPSoCs. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2012. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/67148.

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Council of Science Editors:

Reinbrecht CRW. Desenvolvimento e avaliação de redes-em-chip hierárquicas e reconfiguráveis para MPSoCs. [Thesis]. Universidade do Rio Grande do Sul; 2012. Available from: http://hdl.handle.net/10183/67148

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Universidade do Rio Grande do Sul

7. Palomino, Daniel Munari Vilchez. Algorithm and hardware based architectural design targeting the intra-frame prediction of the HEVC video coding standard.

Degree: 2013, Universidade do Rio Grande do Sul

Este trabalho apresenta uma arquitetura de hardware para a predição intra-quadro do padrão emergente HEVC de codificação de vídeo. O padrão HEVC está sendo desenvolvido… (more)

Subjects/Keywords: Hardware design; Microeletrônica; Video coding; Vlsi : Circuitos integrados : Eletronica; Compressao : Video; Intra-frame prediction; HEVC; Mode decision; Fast algorithms

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APA (6th Edition):

Palomino, D. M. V. (2013). Algorithm and hardware based architectural design targeting the intra-frame prediction of the HEVC video coding standard. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/70236

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Chicago Manual of Style (16th Edition):

Palomino, Daniel Munari Vilchez. “Algorithm and hardware based architectural design targeting the intra-frame prediction of the HEVC video coding standard.” 2013. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/70236.

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MLA Handbook (7th Edition):

Palomino, Daniel Munari Vilchez. “Algorithm and hardware based architectural design targeting the intra-frame prediction of the HEVC video coding standard.” 2013. Web. 17 Jan 2021.

Vancouver:

Palomino DMV. Algorithm and hardware based architectural design targeting the intra-frame prediction of the HEVC video coding standard. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2013. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/70236.

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Council of Science Editors:

Palomino DMV. Algorithm and hardware based architectural design targeting the intra-frame prediction of the HEVC video coding standard. [Thesis]. Universidade do Rio Grande do Sul; 2013. Available from: http://hdl.handle.net/10183/70236

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Universidade do Rio Grande do Sul

8. Matos, Débora da Silva Motta. Exploring hierarchy, adaptability and 3D in NoCs for the next generation of MPSoCs.

Degree: 2014, Universidade do Rio Grande do Sul

The demand for systems with high performance has brought the need to increase the number of cores, emerging the called Multi-Processors System-on-Chip (MPSoCs). Also, with… (more)

Subjects/Keywords: Microeletrônica; Network-on-chip; 3D; Hierarchical topology; Sistemas embarcados; Crossbar; Adaptability; Awitching; 3D designs; 3D interconnects

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APA (6th Edition):

Matos, D. d. S. M. (2014). Exploring hierarchy, adaptability and 3D in NoCs for the next generation of MPSoCs. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/94764

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Chicago Manual of Style (16th Edition):

Matos, Débora da Silva Motta. “Exploring hierarchy, adaptability and 3D in NoCs for the next generation of MPSoCs.” 2014. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/94764.

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MLA Handbook (7th Edition):

Matos, Débora da Silva Motta. “Exploring hierarchy, adaptability and 3D in NoCs for the next generation of MPSoCs.” 2014. Web. 17 Jan 2021.

Vancouver:

Matos DdSM. Exploring hierarchy, adaptability and 3D in NoCs for the next generation of MPSoCs. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2014. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/94764.

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Council of Science Editors:

Matos DdSM. Exploring hierarchy, adaptability and 3D in NoCs for the next generation of MPSoCs. [Thesis]. Universidade do Rio Grande do Sul; 2014. Available from: http://hdl.handle.net/10183/94764

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Universidade do Rio Grande do Sul

9. Bonatto, Alexsandro Cristóvão. Controle adaptativo para acesso à memória compartilhada em sistemas em chip.

Degree: 2014, Universidade do Rio Grande do Sul

Acessos simultâneos gerados por Elementos de Processamento (EP) contidos nos Sistemas em Chip (SoC) para um único canal de memória externa coloca desafios que requerem… (more)

Subjects/Keywords: Microeletrônica; Memory subsystem; Circuitos integrados; Integrated circuits; Memory hierarchy; System-on-chip

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APA (6th Edition):

Bonatto, A. C. (2014). Controle adaptativo para acesso à memória compartilhada em sistemas em chip. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/109193

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Chicago Manual of Style (16th Edition):

Bonatto, Alexsandro Cristóvão. “Controle adaptativo para acesso à memória compartilhada em sistemas em chip.” 2014. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/109193.

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MLA Handbook (7th Edition):

Bonatto, Alexsandro Cristóvão. “Controle adaptativo para acesso à memória compartilhada em sistemas em chip.” 2014. Web. 17 Jan 2021.

Vancouver:

Bonatto AC. Controle adaptativo para acesso à memória compartilhada em sistemas em chip. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2014. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/109193.

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Council of Science Editors:

Bonatto AC. Controle adaptativo para acesso à memória compartilhada em sistemas em chip. [Thesis]. Universidade do Rio Grande do Sul; 2014. Available from: http://hdl.handle.net/10183/109193

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Universidade do Rio Grande do Sul

10. Neves, Bruno Silveira. Proposta de algoritmo de cacheamento para proxies VoD e sua avaliação usando um novo conjunto de métricas.

Degree: 2015, Universidade do Rio Grande do Sul

Atualmente, o serviço digital conhecido como Vídeo sob Demanda - Video on Demand (VoD) - está em ascensão e costuma requerer uma quantidade significativa de… (more)

Subjects/Keywords: Microeletrônica; Video; Algorítmo; Proxy; Caching algorithm

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APA (6th Edition):

Neves, B. S. (2015). Proposta de algoritmo de cacheamento para proxies VoD e sua avaliação usando um novo conjunto de métricas. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/119427

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Chicago Manual of Style (16th Edition):

Neves, Bruno Silveira. “Proposta de algoritmo de cacheamento para proxies VoD e sua avaliação usando um novo conjunto de métricas.” 2015. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/119427.

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MLA Handbook (7th Edition):

Neves, Bruno Silveira. “Proposta de algoritmo de cacheamento para proxies VoD e sua avaliação usando um novo conjunto de métricas.” 2015. Web. 17 Jan 2021.

Vancouver:

Neves BS. Proposta de algoritmo de cacheamento para proxies VoD e sua avaliação usando um novo conjunto de métricas. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2015. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/119427.

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Neves BS. Proposta de algoritmo de cacheamento para proxies VoD e sua avaliação usando um novo conjunto de métricas. [Thesis]. Universidade do Rio Grande do Sul; 2015. Available from: http://hdl.handle.net/10183/119427

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Universidade do Rio Grande do Sul

11. Palomino, Daniel Munari Vilchez. Application-driven temparature-aware solutions for video coding.

Degree: 2017, Universidade do Rio Grande do Sul

This thesis presents application-driven temperature-aware solutions for next generation video coding systems, such as the High Efficiency Video Coding (HEVC). Different from state-of-the-art works, the… (more)

Subjects/Keywords: Circuitos integrados; Temperature management; Vídeo digital; Video coding; Codificacao : Video digital; HEVC; Application-driven; Temperature-aware; Application knowledge; Temperature gradients; Hardware platforms; Architectures; Integrated circuits

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APA (6th Edition):

Palomino, D. M. V. (2017). Application-driven temparature-aware solutions for video coding. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/158186

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Chicago Manual of Style (16th Edition):

Palomino, Daniel Munari Vilchez. “Application-driven temparature-aware solutions for video coding.” 2017. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/158186.

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MLA Handbook (7th Edition):

Palomino, Daniel Munari Vilchez. “Application-driven temparature-aware solutions for video coding.” 2017. Web. 17 Jan 2021.

Vancouver:

Palomino DMV. Application-driven temparature-aware solutions for video coding. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2017. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/158186.

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Council of Science Editors:

Palomino DMV. Application-driven temparature-aware solutions for video coding. [Thesis]. Universidade do Rio Grande do Sul; 2017. Available from: http://hdl.handle.net/10183/158186

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Universidade do Rio Grande do Sul

12. Alves, Thiago Waszak. Sistema de detecção em tempo real de faixas de sinalização de trânsito para veículos inteligentes utilizando processamento de imagem.

Degree: 2017, Universidade do Rio Grande do Sul

A mobilidade é uma marca da nossa civilização. Tanto o transporte de carga quanto o de passageiros compartilham de uma enorme infra-estrutura de conexões operados… (more)

Subjects/Keywords: Faixa de sinalização; Lane detection; Hough transform; Sinalização de trânsito; Intelligent vehicles; Processamento de imagens; Kalman filter; Engenharia de controle e automação; Veículos; RANSAC

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APA (6th Edition):

Alves, T. W. (2017). Sistema de detecção em tempo real de faixas de sinalização de trânsito para veículos inteligentes utilizando processamento de imagem. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/157872

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Chicago Manual of Style (16th Edition):

Alves, Thiago Waszak. “Sistema de detecção em tempo real de faixas de sinalização de trânsito para veículos inteligentes utilizando processamento de imagem.” 2017. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/157872.

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MLA Handbook (7th Edition):

Alves, Thiago Waszak. “Sistema de detecção em tempo real de faixas de sinalização de trânsito para veículos inteligentes utilizando processamento de imagem.” 2017. Web. 17 Jan 2021.

Vancouver:

Alves TW. Sistema de detecção em tempo real de faixas de sinalização de trânsito para veículos inteligentes utilizando processamento de imagem. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2017. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/157872.

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Council of Science Editors:

Alves TW. Sistema de detecção em tempo real de faixas de sinalização de trânsito para veículos inteligentes utilizando processamento de imagem. [Thesis]. Universidade do Rio Grande do Sul; 2017. Available from: http://hdl.handle.net/10183/157872

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Universidade do Rio Grande do Sul

13. Dapper, Roque Eduardo. Desenvolvimento e implementação de algoritmos de compressão aplicados à qualidade da energia elétrica.

Degree: 2013, Universidade do Rio Grande do Sul

Os equipamentos de análise de qualidade da energia elétrica, em sua grande parte, salvam a forma de onda amostrada somente no entorno do instante onde… (more)

Subjects/Keywords: Compression; Qualidade da energia elétrica; Algoritmos; Deflate; Power quality; Reconfigurable hardware

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APA (6th Edition):

Dapper, R. E. (2013). Desenvolvimento e implementação de algoritmos de compressão aplicados à qualidade da energia elétrica. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/115549

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Chicago Manual of Style (16th Edition):

Dapper, Roque Eduardo. “Desenvolvimento e implementação de algoritmos de compressão aplicados à qualidade da energia elétrica.” 2013. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/115549.

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MLA Handbook (7th Edition):

Dapper, Roque Eduardo. “Desenvolvimento e implementação de algoritmos de compressão aplicados à qualidade da energia elétrica.” 2013. Web. 17 Jan 2021.

Vancouver:

Dapper RE. Desenvolvimento e implementação de algoritmos de compressão aplicados à qualidade da energia elétrica. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2013. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/115549.

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Council of Science Editors:

Dapper RE. Desenvolvimento e implementação de algoritmos de compressão aplicados à qualidade da energia elétrica. [Thesis]. Universidade do Rio Grande do Sul; 2013. Available from: http://hdl.handle.net/10183/115549

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Universidade do Rio Grande do Sul

14. Ataide, Fernando Henrique. Proposta de melhoria de tempo de resposta para o protocolo FTT-CAN : estudo de caso em aplicação automotiva.

Degree: 2010, Universidade do Rio Grande do Sul

Nos últimos anos os sistemas embarcados tem-se tornado notório nos mercados de eletroeletrônicos de consumo, automação industrial e comercial e em veículos em geral. Grande(more)

Subjects/Keywords: Real-time system; Sistemas embarcados; Real-time scheduling; Automação industrial; Indústria automobilística; FTT-CAN; Sistema operacional de tempo real; Real-time operating system; Linux

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APA (6th Edition):

Ataide, F. H. (2010). Proposta de melhoria de tempo de resposta para o protocolo FTT-CAN : estudo de caso em aplicação automotiva. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/49296

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Chicago Manual of Style (16th Edition):

Ataide, Fernando Henrique. “Proposta de melhoria de tempo de resposta para o protocolo FTT-CAN : estudo de caso em aplicação automotiva.” 2010. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/49296.

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MLA Handbook (7th Edition):

Ataide, Fernando Henrique. “Proposta de melhoria de tempo de resposta para o protocolo FTT-CAN : estudo de caso em aplicação automotiva.” 2010. Web. 17 Jan 2021.

Vancouver:

Ataide FH. Proposta de melhoria de tempo de resposta para o protocolo FTT-CAN : estudo de caso em aplicação automotiva. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2010. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/49296.

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Council of Science Editors:

Ataide FH. Proposta de melhoria de tempo de resposta para o protocolo FTT-CAN : estudo de caso em aplicação automotiva. [Thesis]. Universidade do Rio Grande do Sul; 2010. Available from: http://hdl.handle.net/10183/49296

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Universidade do Rio Grande do Sul

15. Husemann, Ronaldo. Arquitetura de co-projeto hardware/software para implementação de um codificador de vídeo escalável padrão H.264/SVC.

Degree: 2011, Universidade do Rio Grande do Sul

Visando atuação flexível em redes heterogêneas, modernos sistemas multimídia podem adotar o conceito da codificação escalável, onde o fluxo de vídeo é composto por múltiplas… (more)

Subjects/Keywords: Scalable video coding; Vídeo digital; Algoritmos; H.264/SVC standard; Hardware; Hardware/software co-design; Software; Programmable logics

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APA (6th Edition):

Husemann, R. (2011). Arquitetura de co-projeto hardware/software para implementação de um codificador de vídeo escalável padrão H.264/SVC. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/49305

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Chicago Manual of Style (16th Edition):

Husemann, Ronaldo. “Arquitetura de co-projeto hardware/software para implementação de um codificador de vídeo escalável padrão H.264/SVC.” 2011. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/49305.

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MLA Handbook (7th Edition):

Husemann, Ronaldo. “Arquitetura de co-projeto hardware/software para implementação de um codificador de vídeo escalável padrão H.264/SVC.” 2011. Web. 17 Jan 2021.

Vancouver:

Husemann R. Arquitetura de co-projeto hardware/software para implementação de um codificador de vídeo escalável padrão H.264/SVC. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2011. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/49305.

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Council of Science Editors:

Husemann R. Arquitetura de co-projeto hardware/software para implementação de um codificador de vídeo escalável padrão H.264/SVC. [Thesis]. Universidade do Rio Grande do Sul; 2011. Available from: http://hdl.handle.net/10183/49305

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Universidade do Rio Grande do Sul

16. Parraga, Adriane. Atlas anatômico da região da cabeça e do pescoço : em direção à radioterapia adaptativa.

Degree: 2008, Universidade do Rio Grande do Sul

Em radioterapia externa, uma nova técnica chamada terapia de radiação de intensidade modulada - IMRT - permite delinear a dose de radiação em imagens de… (more)

Subjects/Keywords: Radioterapia; Adaptative radiotherapy; Imagem; Atlas; Registration; Segmentation

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APA (6th Edition):

Parraga, A. (2008). Atlas anatômico da região da cabeça e do pescoço : em direção à radioterapia adaptativa. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/15403

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Chicago Manual of Style (16th Edition):

Parraga, Adriane. “Atlas anatômico da região da cabeça e do pescoço : em direção à radioterapia adaptativa.” 2008. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/15403.

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MLA Handbook (7th Edition):

Parraga, Adriane. “Atlas anatômico da região da cabeça e do pescoço : em direção à radioterapia adaptativa.” 2008. Web. 17 Jan 2021.

Vancouver:

Parraga A. Atlas anatômico da região da cabeça e do pescoço : em direção à radioterapia adaptativa. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2008. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/15403.

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Council of Science Editors:

Parraga A. Atlas anatômico da região da cabeça e do pescoço : em direção à radioterapia adaptativa. [Thesis]. Universidade do Rio Grande do Sul; 2008. Available from: http://hdl.handle.net/10183/15403

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Universidade do Rio Grande do Sul

17. Freitas, Bruno Policarpo Toledo. Adaptação e aceleração do middleware Ginga-NCL para o sistema-em-chip do SBTVD.

Degree: 2014, Universidade do Rio Grande do Sul

Este trabalho tem por finalidade aprimorar o Sistema-em-Chip (SoC) desenvolvido para um "Set-Top Box"de Televisão Digital com a capacidade de executar aplicações segundo o Sistema… (more)

Subjects/Keywords: Digital television; Televisão digital; Set-top box; H.264; Middleware; Ginga; Ginga-NCL

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APA (6th Edition):

Freitas, B. P. T. (2014). Adaptação e aceleração do middleware Ginga-NCL para o sistema-em-chip do SBTVD. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/105062

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Chicago Manual of Style (16th Edition):

Freitas, Bruno Policarpo Toledo. “Adaptação e aceleração do middleware Ginga-NCL para o sistema-em-chip do SBTVD.” 2014. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/105062.

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MLA Handbook (7th Edition):

Freitas, Bruno Policarpo Toledo. “Adaptação e aceleração do middleware Ginga-NCL para o sistema-em-chip do SBTVD.” 2014. Web. 17 Jan 2021.

Vancouver:

Freitas BPT. Adaptação e aceleração do middleware Ginga-NCL para o sistema-em-chip do SBTVD. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2014. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/105062.

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Council of Science Editors:

Freitas BPT. Adaptação e aceleração do middleware Ginga-NCL para o sistema-em-chip do SBTVD. [Thesis]. Universidade do Rio Grande do Sul; 2014. Available from: http://hdl.handle.net/10183/105062

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Universidade do Rio Grande do Sul

18. Aguirre, Paulo Cesar Comassetto de. Projeto e análise de moduladores sigma-delta em tempo contínuo aplicados à conversão AD.

Degree: 2014, Universidade do Rio Grande do Sul

Conversores analógico-digitais (ADCs) têm papel fundamental na implementação dos sistemas-em-chip, do inglês System-on-Chip (SoC), atuais. Em razão dos requisitos destes sistemas e dos compromissos entre… (more)

Subjects/Keywords: Sigma-delta modulation; Conversor analogico/digital; Continuous-time sigma-delta modulator; Modulação; Simulação numérica; Analog-to-digital converter (ADC); Behavioral modeling

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APA (6th Edition):

Aguirre, P. C. C. d. (2014). Projeto e análise de moduladores sigma-delta em tempo contínuo aplicados à conversão AD. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/105065

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Chicago Manual of Style (16th Edition):

Aguirre, Paulo Cesar Comassetto de. “Projeto e análise de moduladores sigma-delta em tempo contínuo aplicados à conversão AD.” 2014. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/105065.

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MLA Handbook (7th Edition):

Aguirre, Paulo Cesar Comassetto de. “Projeto e análise de moduladores sigma-delta em tempo contínuo aplicados à conversão AD.” 2014. Web. 17 Jan 2021.

Vancouver:

Aguirre PCCd. Projeto e análise de moduladores sigma-delta em tempo contínuo aplicados à conversão AD. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2014. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/105065.

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Council of Science Editors:

Aguirre PCCd. Projeto e análise de moduladores sigma-delta em tempo contínuo aplicados à conversão AD. [Thesis]. Universidade do Rio Grande do Sul; 2014. Available from: http://hdl.handle.net/10183/105065

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Universidade do Rio Grande do Sul

19. Silva, Jonas dos Santos. Implementação da compensação de movimento em vídeo entrelaçado no terminal de acesso do SBTVD.

Degree: 2013, Universidade do Rio Grande do Sul

Uma sequencia de vídeo pode ser adquirida de forma progressiva ou entrelaçada. No padrão de codificação de vídeo H.264/AVC os campos de uma imagem entrelaçada… (more)

Subjects/Keywords: H264/AVC; Televisão digital; Processamento de imagens; MBAFF; Hardware; Inter-frame prediction; Motion compensation; Samples processing; Weighted prediction; VHDL; Hardware

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APA (6th Edition):

Silva, J. d. S. (2013). Implementação da compensação de movimento em vídeo entrelaçado no terminal de acesso do SBTVD. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/96500

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Chicago Manual of Style (16th Edition):

Silva, Jonas dos Santos. “Implementação da compensação de movimento em vídeo entrelaçado no terminal de acesso do SBTVD.” 2013. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/96500.

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MLA Handbook (7th Edition):

Silva, Jonas dos Santos. “Implementação da compensação de movimento em vídeo entrelaçado no terminal de acesso do SBTVD.” 2013. Web. 17 Jan 2021.

Vancouver:

Silva JdS. Implementação da compensação de movimento em vídeo entrelaçado no terminal de acesso do SBTVD. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2013. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/96500.

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Council of Science Editors:

Silva JdS. Implementação da compensação de movimento em vídeo entrelaçado no terminal de acesso do SBTVD. [Thesis]. Universidade do Rio Grande do Sul; 2013. Available from: http://hdl.handle.net/10183/96500

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Universidade do Rio Grande do Sul

20. Ilha, Gustavo. Rastreamento automático da bola de futebol em vídeos.

Degree: 2009, Universidade do Rio Grande do Sul

A localização de objetos em uma imagem e acompanhamento de seu deslocamento numa sequência de imagens são tarefas de interesse teórico e prático. Aplicações de… (more)

Subjects/Keywords: Processamento de imagens; Electrical engineering; Signal processing; Filtro de Kalman; Image processing; Processamento de sinais; Kalman filter; Particle filter; Object tracking; Viterbi decoder

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APA (6th Edition):

Ilha, G. (2009). Rastreamento automático da bola de futebol em vídeos. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/23921

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Chicago Manual of Style (16th Edition):

Ilha, Gustavo. “Rastreamento automático da bola de futebol em vídeos.” 2009. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/23921.

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MLA Handbook (7th Edition):

Ilha, Gustavo. “Rastreamento automático da bola de futebol em vídeos.” 2009. Web. 17 Jan 2021.

Vancouver:

Ilha G. Rastreamento automático da bola de futebol em vídeos. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2009. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/23921.

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Council of Science Editors:

Ilha G. Rastreamento automático da bola de futebol em vídeos. [Thesis]. Universidade do Rio Grande do Sul; 2009. Available from: http://hdl.handle.net/10183/23921

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Universidade do Rio Grande do Sul

21. Lopes, Carla Diniz. Um método de avaliação da amplitude do potencial P300 comparando indivíduos com alto risco e baixo risco para o alcoolismo.

Degree: 2010, Universidade do Rio Grande do Sul

A ocorrência de variações nos sinais de eletroencefalograma (EEG) de indivíduos que apresentam predisposição a desenvolver a doença do alcoolismo é conhecida e documentada na… (more)

Subjects/Keywords: Processamento de sinais; EEG classification; Wavelet transform; Redes neurais artificiais; Artificial neural network; Eletroencefalografia; Transformadas wavelet; Alcoholism; Alcoolismo

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APA (6th Edition):

Lopes, C. D. (2010). Um método de avaliação da amplitude do potencial P300 comparando indivíduos com alto risco e baixo risco para o alcoolismo. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/26863

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Chicago Manual of Style (16th Edition):

Lopes, Carla Diniz. “Um método de avaliação da amplitude do potencial P300 comparando indivíduos com alto risco e baixo risco para o alcoolismo.” 2010. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/26863.

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MLA Handbook (7th Edition):

Lopes, Carla Diniz. “Um método de avaliação da amplitude do potencial P300 comparando indivíduos com alto risco e baixo risco para o alcoolismo.” 2010. Web. 17 Jan 2021.

Vancouver:

Lopes CD. Um método de avaliação da amplitude do potencial P300 comparando indivíduos com alto risco e baixo risco para o alcoolismo. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2010. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/26863.

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Council of Science Editors:

Lopes CD. Um método de avaliação da amplitude do potencial P300 comparando indivíduos com alto risco e baixo risco para o alcoolismo. [Thesis]. Universidade do Rio Grande do Sul; 2010. Available from: http://hdl.handle.net/10183/26863

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Universidade do Rio Grande do Sul

22. Lopes, Israel da Costa. Convolutional neural network reliability on an APSoC platform a traffic-sign recognition case study.

Degree: 2017, Universidade do Rio Grande do Sul

Deep learning has a plethora of applications in computer vision, speech recognition, natural language processing and other applications of commercial interest. Computer vision, in turn,… (more)

Subjects/Keywords: Microeletrônica; Deep learning; System-on-Chip; Redes neurais; Informatica : Transportes; Soft errors; Traffic-sign recognition

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APA (6th Edition):

Lopes, I. d. C. (2017). Convolutional neural network reliability on an APSoC platform a traffic-sign recognition case study. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/171094

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Chicago Manual of Style (16th Edition):

Lopes, Israel da Costa. “Convolutional neural network reliability on an APSoC platform a traffic-sign recognition case study.” 2017. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/171094.

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MLA Handbook (7th Edition):

Lopes, Israel da Costa. “Convolutional neural network reliability on an APSoC platform a traffic-sign recognition case study.” 2017. Web. 17 Jan 2021.

Vancouver:

Lopes IdC. Convolutional neural network reliability on an APSoC platform a traffic-sign recognition case study. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2017. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/171094.

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Council of Science Editors:

Lopes IdC. Convolutional neural network reliability on an APSoC platform a traffic-sign recognition case study. [Thesis]. Universidade do Rio Grande do Sul; 2017. Available from: http://hdl.handle.net/10183/171094

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Universidade do Rio Grande do Sul

23. Hoelscher, Igor Gustavo. Detecção e classificação de sinalização vertical de trânsito em cenários complexos.

Degree: 2017, Universidade do Rio Grande do Sul

A mobilidade é uma marca da nossa civilização. Tanto o transporte de carga quanto o de passageiros compartilham de uma enorme infra-estrutura de conexões operados… (more)

Subjects/Keywords: Sinalização de trânsito; Traffic sign detection; Sistemas inteligentes; Traffic sign classification; Visao computacional; Image segmentation; Convolutional neural network

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APA (6th Edition):

Hoelscher, I. G. (2017). Detecção e classificação de sinalização vertical de trânsito em cenários complexos. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/163777

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Chicago Manual of Style (16th Edition):

Hoelscher, Igor Gustavo. “Detecção e classificação de sinalização vertical de trânsito em cenários complexos.” 2017. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/163777.

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MLA Handbook (7th Edition):

Hoelscher, Igor Gustavo. “Detecção e classificação de sinalização vertical de trânsito em cenários complexos.” 2017. Web. 17 Jan 2021.

Vancouver:

Hoelscher IG. Detecção e classificação de sinalização vertical de trânsito em cenários complexos. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2017. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/163777.

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Council of Science Editors:

Hoelscher IG. Detecção e classificação de sinalização vertical de trânsito em cenários complexos. [Thesis]. Universidade do Rio Grande do Sul; 2017. Available from: http://hdl.handle.net/10183/163777

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Universidade do Rio Grande do Sul

24. Orellana Hurtado, Carlos Jesus. Uma Técnica de depuração e teste de circuitos integrados usando um microscópio eletrônico.

Degree: 1986, Universidade do Rio Grande do Sul

 O trabalho tem por objetivo mostrar uma técnica de depuração de circuitos integrados VLSI, utilizando um microscópio eletrônico de varredura (MEV) aliado ao fenômeno de… (more)

Subjects/Keywords: Microeletrônica; Testes : Circuitos integrados; Microscopio eletronico : Varredura; Depuração : Circuitos integrados

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APA (6th Edition):

Orellana Hurtado, C. J. (1986). Uma Técnica de depuração e teste de circuitos integrados usando um microscópio eletrônico. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/2245

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Chicago Manual of Style (16th Edition):

Orellana Hurtado, Carlos Jesus. “Uma Técnica de depuração e teste de circuitos integrados usando um microscópio eletrônico.” 1986. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/2245.

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MLA Handbook (7th Edition):

Orellana Hurtado, Carlos Jesus. “Uma Técnica de depuração e teste de circuitos integrados usando um microscópio eletrônico.” 1986. Web. 17 Jan 2021.

Vancouver:

Orellana Hurtado CJ. Uma Técnica de depuração e teste de circuitos integrados usando um microscópio eletrônico. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 1986. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/2245.

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Council of Science Editors:

Orellana Hurtado CJ. Uma Técnica de depuração e teste de circuitos integrados usando um microscópio eletrônico. [Thesis]. Universidade do Rio Grande do Sul; 1986. Available from: http://hdl.handle.net/10183/2245

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Universidade do Rio Grande do Sul

25. Zimmermann, Flávio Luiz de Oliveira. Um microprocessador com capacidades analógicas.

Degree: 2002, Universidade do Rio Grande do Sul

 Este trabalho apresenta um estudo, implementação e simulação de geradores de sinais analógicos usando-se circuitos digitais, em forma de CORE, integrando-se este com o microprocessador… (more)

Subjects/Keywords: Microeletrônica; Testes : Circuitos integrados; Microprocessadores; Testes : Hardware

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APA (6th Edition):

Zimmermann, F. L. d. O. (2002). Um microprocessador com capacidades analógicas. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/2731

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Chicago Manual of Style (16th Edition):

Zimmermann, Flávio Luiz de Oliveira. “Um microprocessador com capacidades analógicas.” 2002. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/2731.

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MLA Handbook (7th Edition):

Zimmermann, Flávio Luiz de Oliveira. “Um microprocessador com capacidades analógicas.” 2002. Web. 17 Jan 2021.

Vancouver:

Zimmermann FLdO. Um microprocessador com capacidades analógicas. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2002. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/2731.

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Council of Science Editors:

Zimmermann FLdO. Um microprocessador com capacidades analógicas. [Thesis]. Universidade do Rio Grande do Sul; 2002. Available from: http://hdl.handle.net/10183/2731

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Universidade do Rio Grande do Sul

26. Zeferino, Cesar Albenes. Redes-em-Chip : arquiteturas e modelos para avaliação de área e desempenho.

Degree: 2003, Universidade do Rio Grande do Sul

 Com o advento dos processos submicrônicos, a capacidade de integração de transistores tem atingido níveis que possibilitam a construção de um sistema completo em uma… (more)

Subjects/Keywords: Microeletrônica; Circuitos integrados

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APA (6th Edition):

Zeferino, C. A. (2003). Redes-em-Chip : arquiteturas e modelos para avaliação de área e desempenho. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/4179

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Chicago Manual of Style (16th Edition):

Zeferino, Cesar Albenes. “Redes-em-Chip : arquiteturas e modelos para avaliação de área e desempenho.” 2003. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/4179.

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MLA Handbook (7th Edition):

Zeferino, Cesar Albenes. “Redes-em-Chip : arquiteturas e modelos para avaliação de área e desempenho.” 2003. Web. 17 Jan 2021.

Vancouver:

Zeferino CA. Redes-em-Chip : arquiteturas e modelos para avaliação de área e desempenho. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2003. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/4179.

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Council of Science Editors:

Zeferino CA. Redes-em-Chip : arquiteturas e modelos para avaliação de área e desempenho. [Thesis]. Universidade do Rio Grande do Sul; 2003. Available from: http://hdl.handle.net/10183/4179

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Universidade do Rio Grande do Sul

27. Marcon, Cesar Augusto Missio. Modelos para o mapeamento de aplicações em infra-estruturas de comunicação intrachip.

Degree: 2005, Universidade do Rio Grande do Sul

 O projeto de sistemas intrachip (SoCs) é uma atividade de alto grau de complexidade, dados a dimensão de SoCs, na ordem do bilhão de transistores,… (more)

Subjects/Keywords: Microeletrônica; Algoritmos computacionais

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APA (6th Edition):

Marcon, C. A. M. (2005). Modelos para o mapeamento de aplicações em infra-estruturas de comunicação intrachip. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/5016

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Chicago Manual of Style (16th Edition):

Marcon, Cesar Augusto Missio. “Modelos para o mapeamento de aplicações em infra-estruturas de comunicação intrachip.” 2005. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/5016.

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MLA Handbook (7th Edition):

Marcon, Cesar Augusto Missio. “Modelos para o mapeamento de aplicações em infra-estruturas de comunicação intrachip.” 2005. Web. 17 Jan 2021.

Vancouver:

Marcon CAM. Modelos para o mapeamento de aplicações em infra-estruturas de comunicação intrachip. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2005. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/5016.

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Council of Science Editors:

Marcon CAM. Modelos para o mapeamento de aplicações em infra-estruturas de comunicação intrachip. [Thesis]. Universidade do Rio Grande do Sul; 2005. Available from: http://hdl.handle.net/10183/5016

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Universidade do Rio Grande do Sul

28. Cardozo, Rodrigo da Silva. Redes-em-chip de baixo custo.

Degree: 2005, Universidade do Rio Grande do Sul

 Com as recentes tecnologias de fabricação é possível integrar milhões de transistores em um único chip, permitindo a criação dos chamados System-on-Chip (SoCs), que integram… (more)

Subjects/Keywords: Microeletrônica; Sistemas embarcados

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APA (6th Edition):

Cardozo, R. d. S. (2005). Redes-em-chip de baixo custo. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/6304

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Chicago Manual of Style (16th Edition):

Cardozo, Rodrigo da Silva. “Redes-em-chip de baixo custo.” 2005. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/6304.

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MLA Handbook (7th Edition):

Cardozo, Rodrigo da Silva. “Redes-em-chip de baixo custo.” 2005. Web. 17 Jan 2021.

Vancouver:

Cardozo RdS. Redes-em-chip de baixo custo. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2005. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/6304.

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Council of Science Editors:

Cardozo RdS. Redes-em-chip de baixo custo. [Thesis]. Universidade do Rio Grande do Sul; 2005. Available from: http://hdl.handle.net/10183/6304

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Universidade do Rio Grande do Sul

29. Kreutz, Marcio Eduardo. Método para a otimização de plataformas arquiteturais para sistemas multiprocessados heterogêneos.

Degree: 2005, Universidade do Rio Grande do Sul

 A concepção dos sistemas eletrônicos previstos para o futuro próximo implica em uma atividade multidisciplinar, a qual demanda, para o projeto de sistemas eletrônicos, o… (more)

Subjects/Keywords: Microeletrônica

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APA (6th Edition):

Kreutz, M. E. (2005). Método para a otimização de plataformas arquiteturais para sistemas multiprocessados heterogêneos. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/6924

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Chicago Manual of Style (16th Edition):

Kreutz, Marcio Eduardo. “Método para a otimização de plataformas arquiteturais para sistemas multiprocessados heterogêneos.” 2005. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/6924.

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MLA Handbook (7th Edition):

Kreutz, Marcio Eduardo. “Método para a otimização de plataformas arquiteturais para sistemas multiprocessados heterogêneos.” 2005. Web. 17 Jan 2021.

Vancouver:

Kreutz ME. Método para a otimização de plataformas arquiteturais para sistemas multiprocessados heterogêneos. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2005. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/6924.

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Council of Science Editors:

Kreutz ME. Método para a otimização de plataformas arquiteturais para sistemas multiprocessados heterogêneos. [Thesis]. Universidade do Rio Grande do Sul; 2005. Available from: http://hdl.handle.net/10183/6924

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Universidade do Rio Grande do Sul

30. Soares, Andre Borin. Exploração do paralelismo em arquiteturas para processamento de imagens e vídeo.

Degree: 2007, Universidade do Rio Grande do Sul

O processamento de vídeo e imagens é uma área de pesquisa de grande importância atualmente devido ao incremento de utilização de imagens nas mais variadas… (more)

Subjects/Keywords: Microeletrônica; Image processing; Processamento : Imagem; NOC; Image processing architectures; Image processing hardware

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APA (6th Edition):

Soares, A. B. (2007). Exploração do paralelismo em arquiteturas para processamento de imagens e vídeo. (Thesis). Universidade do Rio Grande do Sul. Retrieved from http://hdl.handle.net/10183/10539

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Chicago Manual of Style (16th Edition):

Soares, Andre Borin. “Exploração do paralelismo em arquiteturas para processamento de imagens e vídeo.” 2007. Thesis, Universidade do Rio Grande do Sul. Accessed January 17, 2021. http://hdl.handle.net/10183/10539.

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MLA Handbook (7th Edition):

Soares, Andre Borin. “Exploração do paralelismo em arquiteturas para processamento de imagens e vídeo.” 2007. Web. 17 Jan 2021.

Vancouver:

Soares AB. Exploração do paralelismo em arquiteturas para processamento de imagens e vídeo. [Internet] [Thesis]. Universidade do Rio Grande do Sul; 2007. [cited 2021 Jan 17]. Available from: http://hdl.handle.net/10183/10539.

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Council of Science Editors:

Soares AB. Exploração do paralelismo em arquiteturas para processamento de imagens e vídeo. [Thesis]. Universidade do Rio Grande do Sul; 2007. Available from: http://hdl.handle.net/10183/10539

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